Master Thesis: Configurable Access Policies for Hardware Priority Queue Schedulers

Technology, Data & Digital · Software & Web Development · Embedded Systems · Software Engineering

In short

Masterarbeit zur Untersuchung konfigurierbarer Zugriffspolitiken für Hardware-Prioritätswarteschlangen-Scheduler. Die Arbeit konzentriert sich auf die Modellierung und Bewertung von Leistung und Kosten zur Bereitstellung von Designrichtlinien. Erfordert einen Master-Studenten in Elektrotechnik/Informatik mit Hintergrund in Computerarchitektur und ASIC-Design.

Responsibilities

Untersuchen des Designraums zwischen starren statischen Zugriffsmodi und vollständig softwaregesteuerter Planung.
Bewerten von Kandidatenrichtlinien hinsichtlich funktionaler Leistung (Durchsatz, Arbitrierungslatenz, Fairness) durch High-Level-Modellierung.
Bewerten von Kandidatenrichtlinien hinsichtlich Implementierungskosten (Silizikonfläche, kritischer Pfad, Stromverbrauch) durch RTL-Synthese.
Charakterisieren, wann Konfigurierbarkeit hilft, wann nicht und wie viel Flexibilität „ausreicht“.

Requirements

Master-Student in Elektrotechnik/Computer Engineering, Informatik, Embedded Systems oder ähnlich.
Hintergrund in Computerarchitektur, ASIC-Design, RTL-HDL-Codierung, Scripting und Modellierung (Python/MATLAB).

Desired Qualifications

Interesse und/oder Erfahrung in KI ist ein Plus.

Benefits

Hervorragende Gelegenheit, Ihre Fähigkeiten und Vorstellungskraft einzusetzen, um die Grenzen des Möglichen zu erweitern.
Herausforderungen und die Möglichkeit, Lösungen für einige der weltweit härtesten Probleme zu entwickeln.
Teil eines Teams von vielfältigen Innovatoren zu sein, die sich alle bemühen, über den Status quo hinauszugehen, um das Kommende zu gestalten.

Skills

PythonMATLABRTL HDLAI

#AI#Hardware#Scheduling#Thesis#ASIC Design#Computer Architecture#Embedded Systems#Computer Science

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